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宣布时间：2020-12-07 16:58:05
高速先天生员-- 黄刚
一个“xue淋淋”的案例告诉各人：准确的原理图纷歧定就能爆发准确的PCB设计 。。。。。 。
原理图设计与PCB设计都是研发流程中的必经阶段，， ，， ，，我们知道，， ，， ，，原理图设计是PCB设计的前端流程，， ，， ，，之前的案例也剖析过一个过失的原理图一定会导致一个过失的PCB设计，， ，， ，，可是一份准确的原理图就一定能获得一个准确的PCB设计吗？？？？？？
这次先容一个视频传输�？？？？？？榈纳杓瓢咐� ，， ，，通常接纳的是SDI的接口，， ，， ，，速率倒不像通讯行业那么高，， ，， ，，一样平常以6G到12G这个区间的速率为主 。。。。。 。该单板是从FMC芯片经由平衡器转换成单端75欧姆走线，， ，， ，，然后进入BNC毗连器，， ，， ，，最后通过cable毗连到装备端 。。。。。 �？？？？？？突康牡乃俾适�6.25Gbps，， ，， ，，值得提出的是，， ，， ，，PCB也是客户公司自己设计的，， ，， ，，只是在我们这里举行加工哈 。。。。。 。
原来看上去速率不算太高，， ，， ，，设计难度应该不会很大，， ，， ，，可是板子加工出来，， ，， ，，客户举行测试的时间却泛起了大问题 。。。。。 。下面这张图是客户告诉我们的信息及测试的眼图效果，， ，， ，，客户在BNC毗连器后举行测试，， ，， ，，发明6.25Gbps速率下眼图是闭合的，， ，， ，，而现实的功效测试也批注6.25G速率不可事情，， ，， ，，只能降频再降频到1.25G那么低速的时间才OK 。。。。。 。于是客户就求助我们高速先生，， ，， ，，看看能不可找到缘故原由 。。。。。 。
问题很清晰，， ，， ，，谜底却很模糊 。。。。。 。包括客户和我们的设计工程师都第一时间以为是平衡器前的这段100欧姆差分线是不是走线有点长消耗有点大导致的呢？？？？？？
然而高速先生是理智的，， ，， ，，从走线长度来看才不到3inch，， ，， ，，走线消耗不会是问题，， ，， ，，并且焊盘过孔电容这些地方还做了优化，， ，， ，，阻抗一致性也不会差 。。。。。 。另外从平衡器输入后测试发明尚有不错的眼图也能证实消耗不会很大 。。。。。 。因此看起来最有可能的一个推测应该是要被pass掉了 。。。。。 。
有了之前原理图可能会出问题的履历，， ，， ，，高速先生也逐步关注起原理图的设计来了，， ，， ，，于是在听取了客户提供的信息后，， ，， ，，我们拿到了客户的原理图来检查下，， ，， ，，效果发明原理上应该没太大的问题 。。。。。 。平衡器吸收后把100欧姆的差分线转换成75欧姆的单端线，， ，， ，，原理照旧较量清晰的 。。。。。 。
可是高速先生依然发明了一些非通例的设计，， ，， ，，细看75欧姆单端输出的走线部分，， ，， ，，客户还举行了通过磁珠举行下拉的操作，， ，， ，，应该是用于抗滋扰方面的设计理念 。。。。。 。高速先生立马感受到了一丝丝猫腻，， ，， ，，于是把重点放在这个位置上，， ，， ，，去比照下原理图设计和现实PCB设计的情形 。。。。。 。
果真有了惊人的发明，， ，， ，，从原理图的下拉理念到PCB的实现一定是需要通过走线毗连到磁珠再举行下拉的 。。。。。 。于是我们就看到了如上图所示的在BNC接口位置通过走线毗连到磁珠再举行下拉的操作 。。。。。 。高速先生依附之前累积的履历就立马断定了这个位置就是出问题的地方，， ，， ，，在原理图上只是一根理想的毗连线，， ，， ，，可是到了PCB设计上就立马酿成了200多mil的stub，， ，， ，，理想和现实保存着看起来影响不大可是现实上影响很大的差别！
200多mil的stub绝对会影响6.25Gbps这个速率的信号性能了 。。。。。 。高速先生以为问题的谜底已经找到了，， ，， ，，那么怎样让客户相信呢？？？？？？一样平常客户是较量审慎的，， ，， ，，除非有很明确的谜底，， ，， ，，不然客户也不敢贸贸然的举行改板，， ，， ，，于是高速先生看看能不可在现有的板子上举行debug验证 。。。。。 。高速先生仔细琢磨了PCB文件后，， ，， ，，提出了一个有趣的想法 。。。。。 。
由于75欧姆走线恰恰是走线表层线，， ，， ，，于是给这个想法的实验提供了可能性 。。。。。 。我们建议的要领也很简朴而通俗，， ，， ，，就是用刀直接划断BNC接口位置处关于的stub走线，， ，， ，，就像上图标注的谁人位置 。。。。。 。至于刀嘛，， ，， ，，随便像这种刀都是可以的啦！
客户凭证高速先生的建议举行这个操作后，， ，， ，，获得了惊喜的效果！系统能乐成运行到6.25Gbps这个速率了 。。。。。 。
这个案例的分享就到这里了哈，， ，， ，，明枪易躲冷箭难防，， ，， ，，有时间PCB设计上的stub很是的隐藏，， ，， ，，稍有点大意的话，， ，， ，，就会陷入到stub中而不自知 。。。。。 。原理图上的形貌真正到了PCB设计照旧有许多可能性，， ，， ，，到了高速时代后，， ，， ，，任何一段原理图上理想的走线在PCB上都酿成了不睬想的走线，， ，， ，，带来种种意想不到的高速问题 。。。。。 。因此PCB工程师也需要一直积累履历以及理论知识，， ，， ，，才华在高速时代立于不败之地哈！
